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來源: 發布時間:2024-06-12

由于每對數據線和參考時鐘都是差分的,所以主  板的測試需要同時占用4個示波器通道,也就是在進行PCIe4.0的主板測試時示波器能夠  4個通道同時工作且達到25GHz帶寬。而對于插卡的測試來說,只需要把差分的數據通道  引入示波器進行測試就可以了,示波器能夠2個通道同時工作并達到25GHz帶寬即可。 12展示了典型PCIe4.0的發射機信號質量測試環境。無論是對于發射機測試,還是對于后面要介紹到的接收機容限測試來說,在PCIe4.0 的TX端和RX端的測試中,都需要用到ISI板。ISI板上的Trace線有幾十對,每相鄰線對 間的插損相差0.5dB左右。由于測試中用戶使用的電纜、連接器的插損都可能會不一致, 所以需要通過配合合適的ISI線對,使得ISI板上的Trace線加上測試電纜、測試夾具、轉接  頭等模擬出來的整個測試鏈路的插損滿足測試要求。比如,對于插卡的測試來說,對應的主  板上的比較大鏈路損耗為20dB,所以ISI板上模擬的走線加上測試夾具、連接器、轉接頭、測  試電纜等的損耗應該為15dB(另外5dB的主板上芯片的封裝損耗通過分析軟件進行模擬)。 為了滿足這個要求,比較好的方法是使用矢量網絡分析儀(VNA)事先進行鏈路標定。PCI-E3.0設計還可以使用和PCI-E2.0一樣的PCB板材和連接器嗎?測量PCI-E測試商家

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需要注意的是,每一代CBB和CLB的設計都不太一樣,特別是CBB的 變化比較大,所以測試中需要加以注意。圖4.10是支持PCIe4.0測試的夾具套件,主要包括1塊CBB4測試夾具、2塊分別支持x1/x16位寬和x4/x8位寬的CLB4測試夾具、1塊可 變ISI的測試夾具。在測試中,CBB4用于插卡的TX測試以及主板RX測試中的校準; CLB4用于主板TX的測試以及插卡RX測試中的校準;可變ISI的測試夾具是PCIe4 .0中 新增加的,無論是哪種測試,ISI板都是需要的。引入可變ISI測試夾具的原因是在PCIe4.0 的測試規范中,要求通過硬件通道的方式插入傳輸通道的影響,用于模擬實際主板或插卡上 PCB走線、過孔以及連接器造成的損耗。測量PCI-E測試商家PCI Express物理層接口(PIPE);

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SigTest軟件的算法由PCI-SIG提供,會對信號進行時鐘恢復、均衡以及眼圖、抖 動的分析。由于PCIe4.0的接收機支持多個不同幅度的CTLE均衡,而且DFE的電平也 可以在一定范圍內調整,所以SigTest軟件會遍歷所有的CTLE值并進行DFE的優化,并 根據眼高、眼寬的結果選擇比較好的值。14是SigTest生成的PCIe4.0的信號質量測試 結果。SigTest需要用戶手動設置示波器采樣、通道嵌入、捕獲數據及進行后分析,測試效率 比較低,而且對于不熟練的測試人員還可能由于設置疏忽造成測試結果的不一致,測試項目 也主要限于信號質量與Preset相關的項目。為了提高PCIe測試的效率和測試項目覆蓋 率,有些示波器廠商提供了相應的自動化測試軟件。

規范中規定了共11種不同的Preshoot和De-emphasis的組合,每種組合叫作一個 Preset,實際應用中Tx和Rx端可以在Link Training階段根據接收端收到的信號質量協商 出一個比較好的Preset值。比如P4沒有任何預加重,P7強的預加重。圖4.3是 PCIe3.0和4.0標準中采用的預加重技術和11種Preset的組合(參考資料:PCI Express@ Base Specification4 .0) 。對于8Gbps、16Gbps 以及32Gbps信號來說,采用的預加重技術完 全一樣,都是3階的預加重和11種Preset選擇。PCI-E3.0定義了11種發送端的預加重設置,實際應用中應該用那個?

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要精確產生PCle要求的壓力眼圖需要調整很多參數,比如輸出信號的幅度、預加重、 差模噪聲、隨機抖動、周期抖動等,以滿足眼高、眼寬和抖動的要求。而且各個調整參數之間 也會相互制約,比如調整信號的幅度時除了會影響眼高也會影響到眼寬,因此各個參數的調 整需要反復進行以得到 一個比較好化的組合。校準中會調用PCI-SIG的SigTest軟件對信號 進行通道模型嵌入和均衡,并計算的眼高和眼寬。如果沒有達到要求,會在誤碼儀中進 一步調整注入的隨機抖動和差模噪聲的大小,直到眼高和眼寬達到參數要求。PCIE 3.0的發射機物理層測試;測量PCI-E測試商家

PCI-E測試信號完整性測試解決方案;測量PCI-E測試商家

項目2.12SystemReceiverLinkEqualizationTest:驗證主板在壓力信號下的接收機性能及誤碼率,可以和對端進行鏈路協商并相應調整對端的預加重,針對8Gbps和16Gbps速率。·項目2.13Add-inCardPLLBandwidth:驗證插卡的PLL環路帶寬,針對時鐘和所有支持的數據速率。·項目2.14Add-inCardPCBImpedance(informative):驗證插卡上走線的PCB阻抗,不是強制測試。·項目2.15SystemBoardPCBImpedance(informative):驗證主板上走線的PCB阻抗,不是強制測試。接下來,我們重點從發射機和接收機的電氣性能測試方面,講解PCIe4.0的物理層測試方法。測量PCI-E測試商家